enum | gem5::SparcISA::ASI {
gem5::SparcISA::ASI_IMPLICIT = 0x00
, gem5::SparcISA::ASI_NUCLEUS = 0x4
, gem5::SparcISA::ASI_N = 0x4
, gem5::SparcISA::ASI_NL = 0xC
,
gem5::SparcISA::ASI_NUCLEUS_LITTLE = ASI_NL
, gem5::SparcISA::ASI_AIUP = 0x10
, gem5::SparcISA::ASI_AS_IF_USER_PRIMARY = ASI_AIUP
, gem5::SparcISA::ASI_AIUS = 0x11
,
gem5::SparcISA::ASI_AS_IF_USER_SECONDARY = ASI_AIUS
, gem5::SparcISA::ASI_REAL = 0x14
, gem5::SparcISA::ASI_REAL_IO = 0x15
, gem5::SparcISA::ASI_BLK_AIUP = 0x16
,
gem5::SparcISA::ASI_BLOCK_AS_IF_USER_PRIMARY = ASI_BLK_AIUP
, gem5::SparcISA::ASI_BLK_AIUS = 0x17
, gem5::SparcISA::ASI_BLOCK_AS_IF_USER_SECONDARY = ASI_BLK_AIUS
, gem5::SparcISA::ASI_AIUP_L = 0x18
,
gem5::SparcISA::ASI_AS_IF_USER_PRIMARY_LITTLE = ASI_AIUP_L
, gem5::SparcISA::ASI_AIUS_L = 0x19
, gem5::SparcISA::ASI_AS_IF_USER_SECONDARY_LITTLE = ASI_AIUS_L
, gem5::SparcISA::ASI_REAL_L = 0x1C
,
gem5::SparcISA::ASI_REAL_LITTLE = ASI_REAL_L
, gem5::SparcISA::ASI_REAL_IO_L = 0x1D
, gem5::SparcISA::ASI_REAL_IO_LITTLE = ASI_REAL_IO_L
, gem5::SparcISA::ASI_BLK_AIUP_L = 0x1E
,
gem5::SparcISA::ASI_BLOCK_AS_IF_USER_PRIMARY_LITTLE = ASI_BLK_AIUP_L
, gem5::SparcISA::ASI_BLK_AIUS_L = 0x1F
, gem5::SparcISA::ASI_BLOCK_AS_IF_USER_SECONDARY_LITTLE = ASI_BLK_AIUS_L
, gem5::SparcISA::ASI_SCRATCHPAD = 0x20
,
gem5::SparcISA::ASI_MMU = 0x21
, gem5::SparcISA::ASI_LDTX_AIUP = 0x22
, gem5::SparcISA::ASI_LD_TWINX_AS_IF_USER_PRIMARY = ASI_LDTX_AIUP
, gem5::SparcISA::ASI_LDTX_AIUS = 0x23
,
gem5::SparcISA::ASI_LD_TWINX_AS_IF_USER_SECONDARY = ASI_LDTX_AIUS
, gem5::SparcISA::ASI_QUAD_LDD = 0x24
, gem5::SparcISA::ASI_QUEUE = 0x25
, gem5::SparcISA::ASI_QUAD_LDD_REAL = 0x26
,
gem5::SparcISA::ASI_LDTX_REAL = ASI_QUAD_LDD_REAL
, gem5::SparcISA::ASI_LDTX_N = 0x27
, gem5::SparcISA::ASI_LD_TWINX_NUCLEUS = ASI_LDTX_N
, gem5::SparcISA::ASI_ST_BLKINIT_NUCLEUS = ASI_LDTX_N
,
gem5::SparcISA::ASI_STBI_N = ASI_LDTX_N
, gem5::SparcISA::ASI_LDTX_AIUP_L = 0x2A
, gem5::SparcISA::ASI_TWINX_AS_IF_USER_PRIMARY_LITTLE = ASI_LDTX_AIUP_L
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,
gem5::SparcISA::ASI_STBI_AIUP_L = ASI_LDTX_AIUP_L
, gem5::SparcISA::ASI_LDTX_AIUS_L = 0x2B
, gem5::SparcISA::ASI_LD_TWINX_AS_IF_USER_SECONDARY_LITTLE = ASI_LDTX_AIUS_L
, gem5::SparcISA::ASI_ST_BLKINIT_AS_IF_USER_SECONDARY_LITTLE = ASI_LDTX_AIUS_L
,
gem5::SparcISA::ASI_STBI_AIUS_L = ASI_LDTX_AIUS_L
, gem5::SparcISA::ASI_LTX_L = 0x2C
, gem5::SparcISA::ASI_TWINX_LITTLE = ASI_LTX_L
, gem5::SparcISA::ASI_LDTX_REAL_L = 0x2E
,
gem5::SparcISA::ASI_LD_TWINX_REAL_LITTLE = ASI_LDTX_REAL_L
, gem5::SparcISA::ASI_LDTX_NL = 0x2F
, gem5::SparcISA::ASI_LD_TWINX_NUCLEUS_LITTLE = ASI_LDTX_NL
, gem5::SparcISA::ASI_DMMU_CTXT_ZERO_TSB_BASE_PS0 = 0x31
,
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, gem5::SparcISA::ASI_IMMU_CTXT_ZERO_TSB_BASE_PS0 = 0x35
, gem5::SparcISA::ASI_IMMU_CTXT_ZERO_TSB_BASE_PS1 = 0x36
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, gem5::SparcISA::ASI_STREAM_MA = 0x40
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gem5::SparcISA::ASI_BLK_SL = 0xF9
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, gem5::SparcISA::MAX_ASI = 0xFF
} |